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综述
ispClock5610A和ispClock5620A是在系统可编程的、高扇出增强的零延时时钟发生器,适用于高性能通信和计算应用。
ispClock5610A提供高达10个单端或5个差分时钟输出,ispClock5620A提供高达20个单端或10个差分时钟输出。
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 结构图
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特性
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- 8MHz至400MHz输入/输出工作
- 低输出至输出的相偏 (<50ps)
- 低抖动的峰-峰值
- 多达20个可编程的扇出缓冲器
- 可编程的输出标准以及可单独的控制
- LVTTL, LVCMOS, HSTL, eHSTL, SSTL, LVDS, LVPECL, 差分HSTL, SSTL
- 可编程的输出阻抗
- 可编程的回转率
- 多达10个具有单独VCCO和GND的块
- 完全集成的高性能PLL
- 可编程锁定检测
- 通过以下方式控制乘除比率
- 输入分频器 (1至40)
- 反馈分频器 (1至40)
- 五个输出分频器 (2至80偶数倍)
- 可编程的片上环路滤波器
- 兼容扩频时钟
- 每个输出具有精密的可编程相位调节(相偏)
- 16 种设置;最小步长156ps
- 高达+/- 12ns的相偏范围
- 粗、细调节模式
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- 多达五个时钟频率域
- 灵活的时钟参考和外部反馈输入
- 可编程的输入标准
- LVTTL, LVCMOS, SSTL, HSTL, LVDS, LVPECL, 差分HSTL, SSTL
- 时钟A/B选择多路复用器
- 反馈A/B选择多路复用器
- 可编程的终端
- 所有输入和输出支持热插拔
- 在E2CMOS® 存储器中存放四组用户可编程的配置
- 完整的JTAG边界扫描测试在系统编程支持
- 超强的抗电源噪声功能
- 商业(0至70°C)和工业(-40至85°C)温度范围
- 100-pin和48-pin TQFP封装
- 应用
- 电路板公共时钟的生成和分配
- 基于PLL的频率生成
- 高扇出的时钟缓冲器
- 零延时时钟缓冲器
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典型应用
从单个信号源生成和分配多个电路板时钟
- 生成多个频率
- 支持多种信号逻辑接口
- 补偿走线长度和负载差异
- 采用走线长度匹配来改善信号完整性
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